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arm软核设计
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10 文钱
文钱不够?
目录 摘 要 第一章 绪论 第二章 IGATE Design Verification项目 第三章 自己的设计 第四章 Verilog HDL实现 第五章 仿真与综合 致谢 参考文献 毕业设计小结 附录 附图1:主要部件的接口信号图 附图2:存储器接口状态转换图 附图3:部分接口信号电路实现: 附图4:将要使用的cache结构图 附图5:全部指令合成并优化后的状态转换图 附图6:与存储器接口部分的CPU端状态转换图(top) 附图7:与存储器接口部分的CPU端状态转换图(存数据) 附图8:与存储器接口部分的CPU端状态转换图(取数据) 附图9:与存储器接口部分的存储器端状态转换图 附图10:内部接口信号图